ADT7467
Table 42. ADT7467 REGISTERS (continued)
De-
Lock ?
Addr.
0x66
R/W
R/W
Description
PWM3 min
Bit 7
7
Bit 6
6
Bit 5
5
Bit 4
4
Bit 3
3
Bit 2
2
Bit 1
1
Bit 0
0
fault
0x80
able
Yes
duty cycle
0x67
R/W
Remote 1
7
6
5
4
3
2
1
0
0x9A
Yes
temp T MIN
0x68
0x69
R/W
R/W
Local temp T MIN
Remote 2 temp
7
7
6
6
5
5
4
4
3
3
2
2
1
1
0
0
0x9A
0x9A
Yes
Yes
T MIN
0x6A
R/W
Remote 1 THERM
7
6
5
4
3
2
1
0
0xA4
Yes
temperature limit
0x6B
R/W
Local THERM
7
6
5
4
3
2
1
0
0xA4
Yes
temperature limit
0x6C
R/W
Remote 2 THERM
7
6
5
4
3
2
1
0
0xA4
Yes
temperature limit
0x6D
R/W
Remote 1 and
HYSR1
HYSR1
HYSR1
HYSR1
HYSL
HYSL
HYSL
HYSL
0x44
Yes
local temp/T MIN
hysteresis
0x6E
R/W
Remote 2 temp/
HYSR2
HYSR2
HYSR2
HYRS
RES
RES
RES
RES
0x40
Yes
T MIN hysteresis
0x6F
R/W
XNOR tree test
RES
RES
RES
RES
RES
RES
RES
XEN
0x00
Yes
enable
0x70
R/W
Remote 1 temper-
7
6
5
4
3
2
1
0
0x00
Yes
ature offset
0x71
R/W
Local temperature
7
6
5
4
3
2
1
0
0x00
Yes
offset
0x72
R/W
Remote 2 temper-
7
6
5
4
3
2
1
0
0x00
Yes
ature offset
0x73
R/W
Configuration
SHDN
CONV
ATTN
AVG
AIN4
AIN3
AIN2
AIN1
0x00
Yes
Register 2
0x74
0x75
R/W
R/W
Interrupt Mask 1
register
Interrupt Mask 2
OOL
D2
R2T
D1
LT
F4P
RIT
FAN3
RES
FAN2
V CC
FAN1
V CCP
OVT
RES
RES
0x00
0x00
register
0x76
0x77
R/W
R/W
Extended
Resolution 1
Extended
RES
TDM2
RES
TDM2
V CC
LTMP
V CC
LTMP
V CCP
TDM1
V CCP
TDM1
RES
RES
RES
RES
0x00
0x00
Resolution 2
0x78
R/W
Configuration
DC4
DC3
DC2
DC1
FAST
BOOST
THERM
ALERT
0x00
Yes
Register 3
Enable
0x79
R
THERM timer
TMR
TMR
TMR
TMR
TMR
TMR
TMR
ASRT/
0x00
status register
TMR0
0x7A
R/W
THERM timer
LIMT
LIMT
LIMT
LIMT
LIMT
LIMT
LIMT
LIMT
0x00
limit register
0x7B
R/W
TACH pulses
FAN4
FAN4
FAN3
FAN3
FAN2
FAN2
FAN1
FAN1
0x55
per revolution
0x7C
R/W
Configuration
RES
RES
RES
RES
GPIOP
GPIOD
LF/HF
Twos
0x00
Yes
Register 5
Compl
0x7D
R/W
Configuration
RES
RES
BpAtt
RES
AINL
AINL
Pin 9
Pin 9
0x00
Yes
Register 4
V CCP
Func
Func
0x7E
R
Manufacturer’s
DO NOT WRITE TO THESE REGISTERS
0x00
Yes
Test Register 1
0x7F
R
Manufacturer’s
DO NOT WRITE TO THESE REGISTERS
0x00
Yes
Test Register 2
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